Compression de code pour processeurs haute performance, H. Ozaktas, K. Heydemann - pp.1035-1059Systèmes de mémoire transactionnelle pour les architectures à base de NoC. Conception, implémentation et comparaison de deux politiques, Q. Meunier, F. Pétrot - pp.1061-1087Modélisation UML/MARTE de SoC et analyse temporelle basée sur l'approche synchrone. Vers l'exploration à haut niveau de l'architecture, A. Abdallah, A. Gamatié, J. Dekeyser - pp.1089-1113Accélération de la simulation modulaire, M. Bouache, D. Parello, B. Goossens - pp.1115-1134
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